summaryrefslogtreecommitdiff
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authorFabian Montero <fabian@posixlycorrect.com>2023-10-04 18:28:59 -0600
committerFabian Montero <fabian@posixlycorrect.com>2023-10-04 18:28:59 -0600
commitc0048dbf8f4bc963f37bfbf2bfbafcd111479d85 (patch)
tree3aecec38f61ad6ddcf40174fd5013bafd57c5006
parentdc14faa1cf9021432601ab5f1f20b658dea1bbdf (diff)
explica composición de cache en archivo SRAM.
Diffstat (limited to '')
-rw-r--r--rtl/cache/sram.sv6
1 files changed, 5 insertions, 1 deletions
diff --git a/rtl/cache/sram.sv b/rtl/cache/sram.sv
index fc68185..4237233 100644
--- a/rtl/cache/sram.sv
+++ b/rtl/cache/sram.sv
@@ -23,9 +23,13 @@ module cache_sram
// Define la cantidad de líneas de cache
// Cantidad de bits en addr_index = 9, entonces se le hace left shift 9
- // espacios 1. Osea, 512.
+ // espacios a 1. Osea, 512.
localparam DEPTH = 1 << $bits(addr_index);
+ // Estas tres secciones constituyen a una línea de caché.
+ // data_file: Donde se guarda la información cacheada
+ // tag_file: Se guardan los tags de las líneas de caché.
+ // state_file: Se guarda el estado de cada línea de caché. (Acá están todos los estados de MESI)
line data_file[DEPTH] /*verilator public*/;
addr_tag tag_file[DEPTH] /*verilator public*/;
line_state state_file[DEPTH] /*verilator public*/;